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数据缓冲
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2013-12-16 关于DSP编程的几个关键问题
在通信领域,为了充分利用DSP的片上外设资源,常常利用DMA把从串口来的数据或要发的数据放入缓冲区,再处理。对DMA而言,只要其在数据缓冲区的指针指向了中断应发生的位置,就产生中断。但此时最后一个数据只是进入了McBSP而并未真正发出去,所以在传送结束的中断程序中只能关闭DMA不能关闭McBSP。
2011-01-27 基于VHDL和FPGA的非对称同步FIFO设计实现
为了提高效率和降低系统设计的难度,本文采用VHDL描述语言,充分利用Xilinx公司Spartan II FPGA的系统资源,设计实现了一种非对称同步FIFO(输入与输出数据总线宽度不一致的同步FIFO),它不仅提供数据缓冲,而且能进行数据总线宽度的转换。
2008-05-08 乒乓操作及串并转换设计篇
输入数据流通过“输入数据选择单元”将数据流等时分配到两个数据缓冲区,数据缓冲模块可以为任何存储模块,比较常用的存储单元为双口RAM(DPRAM) 、单口RAM(SPRAM) 、FIFO等。
2007-08-31 (多图) BlackfinDSP并行外围接口在红外视频处理通用模块中的应用研究
介绍了Blackfin系列DSP的并行外围接口,提出了一种红外视频处理通用模块的构架,省略了数据缓冲硬件环节,缩短了数据等待时间,提高了DSP的运算效率。
2005-11-09 具备优越寻址功能的帧缓冲器
LOGIC Devices开始交付LF3312 帧缓冲器/先进先出存储器(FIFO)的样品。LF3312 芯片内集成了12 MB内存及先进的寻址控制逻辑,能简化现代视讯及数据缓冲系统的设计工作,而这类缓冲系统通常是应用标准同步随机存储器结合逻辑的解决方案来实现。
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