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2010-09-20 SSTA–概况
过去,静态时序分析被用来分析SoC是否能够在规定的目标频率工作。时序验收要么在最差情况(WCS),要么在最佳情况(BCS)下完成。通常,这些与三西格玛区域对应。当然,为了结束这些情况下的时序,可能进行了大量过度设计。
2009-09-30 (多图) 通信集成电路芯片物理设计难点及解决方案
本文分析了超深亚微米工艺下超大规模通信集成电路物理设计面临的挑战,并在此基础上介绍了IBM相应的解决方案,如基于ALSIM系列工具的电源网络的分析设计流程、统计静态时序分析方法(StatisticsStaticTimingAnalysis,SSTA)、时钟树优化工具BCO(BonnClockOpt,BCO),多种高性能的高速串并/并串转换器(High-SpeedSerdes,HSS)及其完备而精确的仿真和建模环境,这些方案的实施为复杂通信集成电路芯片的物理设计提供了有力的保障,极大地促进通信芯片的开发与应用。
2008-06-11 微捷码的 Talus 及 Quartz 软件获得台积电认证
微捷码(Magma?)设计自动化有限公司于宣布微捷码的Talus?集成电路实现系统、Quartz? SSTA统计分析工具、Quartz DFM(可制造性设计)、Quartz LVS 以及 SiliconSmart? DFM 能够通过台湾积体电路制造股份有限公司(TSMC)9.0版参考流程进行访问。
2007-04-02 特性描述工具辅助创建SSTA
为了应对工艺变动,同时在新型数字IC 设计过程中实现性能、功耗和产量的最佳结合,IC 设计业正在从静态时序分析(STA)工具转向统计性 STA(SSTA)工具。
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2000亿元永远收不回的投资,换来一张五年就停止发展的TD-SCDMA网,而所谓自主知识产权比例饱受争议。蛮力改写科技产业路线,失败作结。[详细]


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