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锁相环芯片
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2013-07-10 (多图) 锁相环揭秘
在混合信号芯片上设计数字通信系统时,数字设计人员因PLL与生俱来的模拟特性,都倾向于避免使用PLL,而模拟设计人员又嫌IDE涉及编码,对其敬而远之。本文将介绍一种设计简单PLL的不同方法。
2011-11-14 (多图) 射频锁相频率合成器的设计与仿真
简要介绍了锁相环频率合成器的基本原理,并利用整数N锁相芯片ADF4112设计了一个宽波段的频率合成器。讨论了其中主要元器件的选择和环路滤波器的设计,利用先进设计系统(Advanced Design System,ADS)仿真软件对设计方案进行频城和瞬态响应仿真,并使用其中的优化工具对各个参数进行优化。
2011-10-22 (多图) 电荷泵锁相环的数字锁定检测电路应用分析
本文介绍了电荷泵锁相环电路锁定检测的基本原理,通过分析影响锁相环数字锁定电路的关键因子,推导出相位误差的计算公式。并以CDCE72010 为例子,通过实验验证了不合理的电路设计或外围电路参数是如何影响电荷泵锁相环芯片数字锁定指示的准确性。
2011-07-21 Hittite推出高精度宽带锁相环芯片:HMC830LP6GE
Hittite 微波公司是在通信及军事市场拥有完整的MMIC解决方案的世界级供应商。该公司最近拓展了其领先业界的锁相环产品线,推出高精度宽带锁相环芯片HMC830LP6GE,工作频率为25MHz—3000MHz,覆盖所有常用的通信频段。
2011-07-21 (多图) 高精度宽带锁相环HMC830LP6GE
Hittite 微波公司是在通信及军事市场拥有完整的MMIC解决方案的世界级供应商。该公司最近拓展了其领先业界的锁相环产品线,推出高精度宽带锁相环芯片HMC830LP6GE,工作频率为25MHz—3000MHz,覆盖所有常用的通信频段。
2010-11-29 RF/微波产品系列新增用于宽带通信设计的高集成度解调器
?与使用多个芯片的分立解决方案不同,ADI 公司的单芯片解调器ADRF 6850将一个60dB VGA(可变增益放大器)、一个小数N分频 PLL (锁相环)频率合成器、一个 VCO (压控振荡器)和两个基带 ADC 驱动器全部集成于一个8 mm x 8 mm LFCSP 封装中,从而显著节省电路板空间,降低成本,并且简化开发工作。
2010-06-04 (多图) 可实现快速锁定的FPGA片内延时锁相环设计
延时锁相环(DLL)是一种基于数字电路实现的时钟管理技术。DLL可用以消除时钟偏斜,对输入时钟进行分频、倍频、移相等操作。文中介绍了FPGA芯片内DLL的结构和设计方案,在其基础上提出可实现快速锁定的延时锁相环OSDLL设计。在SMIC 0.25μm工艺下,设计完成OSDLL测试芯片,其工作频率在20~200 MHz,锁定时间相比传统架构有大幅降低。
2010-05-04 Hittite PLL以质取胜
频率源可以说是一个通信系统的心脏,心脏的好坏很大程度上决定着一个机体的健康状况,而锁相环又是频率源的主要组成部分,因此性能优异的锁相环芯片对于通信系统来说是非常重要的。
2010-04-21 模拟锁相环NE564在FM解调电路中的应用
介绍了锁相鉴频电路的工作原理和模拟锁相环芯片 NE564的结构与特点,并用该芯片设计了一款41.4MHz的FM解调电路,具有较强的实用性。
2009-10-26 (多图) 基于FPGA的高速时钟数据恢复电路的实现
本文提出了一种利用Altera FPGA中的锁相环及Logiclock等技术,实现高速时钟恢复电路的方法。电路是在Altera的EP2C5T144C6芯片上实现的,用于数字光端机的接收端从100路2.048MHz压缩视频码流合成的串行码流中正确提取100路视频码流,其工作频率为204.8MHz,通过硬件验证电路可以正确工作。
2009-06-17 (多图) 一种基于CMOS工艺的电荷泵锁相环芯片的设计
使用0.5 μm CMOS工艺实现5 V锁定范围为41~110 MHz,3 V时锁定范围为25~58 MHz的锁相环单片集成电路,经过分部仿真和总体系统仿真可知,运用本文所述方法设计二阶三型锁相环芯片各组成部分特性与理论相符
2008-12-18 实用的调频接收机电路设计
本设计主要由以下三部分组成:一、音芯片CXA1691,它是集调幅、调频、锁相环、立体声解码等电路为一体的AM/FM立体声收音IC。二、相环芯片BU2614,通过合理设计环路滤波器,频率能够稳定在88~108MHz。三、DC-DC变换电路,实现了系统的低功耗和单电源供电。
2008-10-23 参赛文章2:FM/FSK无线接收与解调
本文主要讲述由NE564 高频锁相环集成芯片为中心组成的FM/FSK接收解调电路系统,文章还阐述了数字调制解调(ASK、FSK、PSK)、锁相环技术的基本原理以及与此相应涉及的一些一般问题。通过对不同频率锁相环芯片的比较,选用NE564作为本电路所使用的芯片完成本电路的设计,分析了FM/FSK的具体电路实现的全过程,也对实际电路制作的一般方法以及常见问题作了说明。
2007-04-28 工程师博客:unicast、broadcast、multicast的区别
看到三级钟(stratum3)芯片DS3100中的锁相环带宽可以到0.5mHZ,开始以为是0.5MHz,后来看过了锁相环的作用后明白应该是0.0005Hz,而不是500Hz。
2007-03-26 (多图) 巧妙利用数字锁相环测量汽车转速
本设计运用数字锁相芯片具有的锁相和压控振荡功能,产生高频振荡,驱动可变计数器进行不同分频,产生的与汽车转速成正比的信号经计数、译码后显示测量结果。配以合理的传感器采集信号,可用于不同汽缸的汽车转速的测量,具有一定的实用价值和应用前景。
2007-02-13 (多图) 宽频带数字锁相环的设计及基于FPGA的实现
数字锁相环(DPLL)技术在数字通信、无线电电子学等众多领域得到了极为广泛的应用。与传统的模拟电路实现的PLL相比,DPLL具有精度高、不受温度和电压影响、环路带宽和中心频率编程可调、易于构建高阶锁相环等优点。随着集成电路技术的发展,不仅能够制成频率较高的单片集成锁相环路,而且可以把整个系统集成到一个芯片上去。
2006-12-06 (多图) 基于MC145152-2芯片的频率合成器的设计
频率合成技术是现代通信的重要组成部分,它是将一个高稳定度和高准确度的基准频率经过四则运算,产生同样稳定度和准确度的任意频率。随着大规模集成电路的发展,利用锁相环频率合成技术研制出了很多频率合成集成电路。其中,以摩托罗拉公司的MC14515x-2系列较为先进,本文将介绍一种基于MC145152-2芯片的频率合成器。这种锁相环频率合成器的稳定度和准确度与基准频率相当,不产生额外的误差。它在移动通信等领域有着广泛的应用
2006-09-19 (多图) 用集总LC元件的VCO构成155.520MHz锁相时钟频率源
介绍了一种用MAX2620构建的窄带压控振荡器(VCO),在此基础上介绍其与锁相环芯片Q3236一起构建SDH专用的155.520MHz点频锁相式时钟源的设计方案。该时钟源具有低噪声、高稳定性等特点,并且成本低廉,具有良好的应用前景。
2006-07-01 (多图) 智能全数字锁相环的设计
数字锁相环路已在数字通信、无线电电子学及电力系统自动化等领域中得到了极为广泛的应用。随着集成电路技术的发展,不仅能够制成频率较高的单片集成锁相环路,而且可以把整个系统集成到一个芯片上去。在基于FPGA的通信电路中,可以把全数字锁相环路作为一个功能模块嵌入FPGA中,构成片内锁相环
2006-05-08 (多图) 双环路集成锁相频率合成器MBl5U36的原理与应用
本文介绍的富士通公司生产的MBl5U36是一种高性能的双环集成锁相环频率合成器,芯片内集成了锁相频率合成器的多种重要部件,使用时只需再合理搭配上一或二块集成电路和少量的外围电路,即可构成一个完整且可靠性很高的频率合成器,该电路的设计简单,应用灵活,且能减小系统体积。
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