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模拟除法器
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2014-09-19 (多图) 一种模拟除法的设计及仿真验证
设计了一种模拟除法, 核心电路由第二代电流传输器和一个电压电流转换电路构成。采用CSMC0.5umCMOS工艺进行设计,并用Cadence Spectre软件对电路进行了仿真,结果表明,在+5V的单电源供电下,-3dB带宽达到了60MHz,整个电路的静态功耗低至4.5mW。
2009-05-15 基于Verilog计算精度可调的整数除法的设计
除法器是电子技术领域的基础模块,在电子电路设计中得到广泛应用。目前,实现除法器的方法有硬件实现和软件实现两种方法。硬件实现的方法主要是以硬件的消耗为代价,从而有实现速度快的特点。用硬件的方法来实现除法的研究很多,如利用微处理器实现快速乘除法运算,FPGA实现二进制除法运算,模拟除法器等;而通过软件实现的除法器算法,可以大大提高器件的工作频率和设计的灵活性,可以从总体上提高设计性能,而设计高效实用的算法是除法器的关键,故除法器的算法研究成为现今热点。
2007-04-19 使用少量元件的模拟除法
虽然微处理器能够提供更精密的运算,但模拟计算技术在设计电路时仍能找到自己的位置。
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