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异步计数器
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2011-08-29 (多图) 基于VHDL的异步FIFO设计
FIFO经常应用于从一个时钟域传输数据到另一个异步时钟域。为解决异步FIFO设计过程中空满标志判断难以及FPGA亚稳态的问题,提出一种新颖的设计方案,即利用格雷码计数器(每次时钟到来仅有1位发生改变)表示读/写指针,设计二级同步链为跨越不同时钟域的读/写指针,以提供充足的稳定时间,并通过对比格雷码指针产生空满标志位。
2010-12-02 内置电平转换器的通用异步收发器
XR16M890和 XR20M1280的主要区别是CPU总线接口。XR16M890带有一个可选的8位Intel、Motorola、VLIO 总线接口。XR20M1280带有一个可选的I2C/SPI总线接口。SPI接口上时钟频率最高为26MHz。两款产品均具备的功能包括

自动RTS/CTS硬件流控、自动XON/XOFF 软件流控、TX/RX FIFO计数器、可选/可编程的收发FIFO触发电平、分数和独立TX/RX波特率生成器。

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