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2009-10-26 (多图) 基于FPGA的高速时钟数据恢复电路的实现
本文提出了一种利用Altera FPGA中的锁相环及Logiclock等技术,实现高速时钟恢复电路的方法。电路是在Altera的EP2C5T144C6芯片上实现的,用于数字光端机的接收端从100路2.048MHz压缩视频码流合成的串行码流中正确提取100路视频码流,其工作频率为204.8MHz,通过硬件验证电路可以正确工作。
2008-11-05 海外捉虫记—DSE能否覆盖所有设计空间
FPGA的布局布线就像PCB一样,好的布局不但能够提高布通率,系统的时序也更容易收敛。不同于PCB设计之处在于,FPGA的布局布线很难手工操作。虽然可以用Logiclock约束一下大致的布局位置,但是绝大多数布局工作还是要依靠EDA工具的计算和权衡。
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说说TD-SCDMA的经验和教训

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2000亿元永远收不回的投资,换来一张五年就停止发展的TD-SCDMA网,而所谓自主知识产权比例饱受争议。蛮力改写科技产业路线,失败作结。[详细]


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