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(多图) 基于DSP和DDS的三维感应测井高频信号源实现

维库电子开发网?? 2010年01月11日 ?? 收藏0

  引言

  高频信号源设计是三维感应测井的重要组成部分。三维感应测井的原理是利用激励信号源通过三个正交的发射线圈向外发射高频信号,再通过多组三个正交的接收线圈,得到多组磁场分量,从而准确测量地层各向异性电阻率。在测井过程中,要求信号源的频率为高频,并且要求信号的频率有很高的稳定性。

  产生信号的方法很多,可以采用函数发生器外接分立元件来实现,通过调节外接电容或电阻来设置输出信号频率。但输出信号受外部分立器件参数影响很大,且输出信号频率不能太高,同时无法实现频率步进调节。另外,采用FPGA可实现信号发生器的设计。但当输出高频信号时,需要高速D/A 来配合工作。本文采用数字直接合成技术,采用专用集成芯片AD9834作为信号产生模块,由ADSP21992来作为控制器来完成整个系统的设计。利用此方法不仅克服了外搭分立元件的干扰,而且AD9834内部有D/A转换器,缩小了信号源的体积,从而满足了测井仪器的要求。

  信号源系统设计

  系统总体框图如图1所示。系统选ADSP21992作为主控制器,通过键盘显示与控制芯片7279来接收功能设置和参数设置等信息,并将输出信号等信息送到数码管显示。同时,控制器将读取的按键信息转换成控制命令通过串行接口送给AD9834,由AD9834产生正弦信号,再经过信号调理,使信号达到设计的要求。

信号源整体设计框图

图1 信号源整体设计框图

  ADSP21992控制DDS模块

  本设计采用ADSP21992作为控制器件,它的最高工作时钟频率达到150MHz,提供一个独立的、标准的串行外设接口SPI,在此主要利用SPI总线向AD9834发送频率控制字,使AD9834产生符合要求的高频信号。串行外设接口SPI提供了一个4线、全双工串行总线的能力,本设计中SPI器件不需要接收数据,因此将它配置为主器件。SPI使用4个信号:主出从入(MOSI)、主入从出(MISO)、串行时钟(SCLK)、从选择(SPISS)。其中串行时钟频率最高可以是外设时钟频率的1/4。AD9834的电源电压在2.3V到 5.5V范围内可选,ADSP21992的电源电压为3.3V,所以在连接时无需电平转换。由于ADSP21992只向AD9834发送数据,不需要接收数据,因此要将ADSP21992的SPI设置为主器件。具体接口电路如图2所示。

ADSP21992与AD9834的接口

图2 ADSP21992与AD9834的接口

  DDS电路设计

  DDS电路设计主要包括接口电路、DDS芯片及信号调理电路等,接口电路主要对DSP发送来的信号进行接收,接收DSP的控制命令,DDS根据收到的DSP控制命令及接收到的频率控制字,生成符合频率要求的信号并输出。由于DDS的输出为电流信号,因此,必须将电流信号通过负载转换为电压信号,将得到的电压信号进行调理即可得到所需的正弦信号。DDS电路设计的原理框图如图3所示。

图3 DDS电路设计的原理框图

  DDS模块

  直接数字合成(DDS)技术具有输出信号精度高、变频速度快、输出信号连续、控制方便及性价比高等诸多优点,因而适用于高频、高精度正弦信号发生器的设计。本系统选用AD9834,它主要由数控振荡器(NCO)、相位调制器、正弦查询表ROM和1个 10位D/A转换器组成。数控振荡器和相位调制器主要由2个频率选择寄存器、1个相位累加器、2个相位偏移寄存器和1个相位偏移加法器构成,它的最高工作频率可达50MHz。AD9834的输出频率f0由(1)式求得

公式

  其中fMCLK为AD9834的时钟频率; FREQREG为写入28位频率寄存器的值; fMCLK/228为频率分辨率。在本设计中选择fMCLK=16.384MHz,频率的分辨率为0.0061MHz,满足设计要求。根据公式(1)代入 fMCLK="16".384MHz, f0=20kHz,求得

公式

  将FREQREG的值反代入公式(1)得到AD9834的真实输出频率为

公式

  差分放大电路设计

  差分放大环节采用AD公司生产的AD620芯片。AD620是低功耗、低噪声、高性能仪表放大器,通过外接一个电阻可以改变其增益(范围为1到10000)。可以很好地完成差分信号到单端信号的转换。其管脚如图4所示。其中RG端为外接电阻端,通过其调节电压增益;+IN、-IN分别为差分器输入的同相端和反相端;+Vs、-Vs分别为正负电源端;OUTPUT为信号输出端;REF为输出参考电源端。

 AD620管脚图

图4 AD620管脚图


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AD9834? DSP? DDS? 测井?

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