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EDN China>EDN论坛>模拟器件技术论坛专区>[征文+原创]如何提高AD9629采样的信噪比?
楼主 问题:

[征文+原创]如何提高AD9629采样的信噪比?

发布时间:2013-1-17 下午11:37

作者: bitao1983

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如何提高AD9629采样的信噪比?
? ? ? ? AD9629电路图如下所示:
? ? ? ? 中频部分送过来的21.4M,通过AD巴伦转为差分后,送到AD8369进行放大,再进过匹配滤波网络后送给AD9629采样。

1.jpg

? ? ? ? AD9629使用30M的采样频率,时钟是由一个低抖动的硅晶振提供,低抖动的电源使用三端子电容滤波,再进过巴伦单端转差分,在进过二极管钳位后提供给AD9629。电路如下图:
2.jpg

? ? ? ? ?时钟部分问题很多,第一选用的硅晶振自生谐波较多,30M出来的波形很差,抖动也很大,第二晶振会通过电源和地影响整个AD前端的电路,没有接晶振时AD电路3.3V的纹波在40mv左右,加入AD后增加到100mv左右!
? ? ? ? ?纹波测试都是在示波器全带宽的基础上测量的!不知道这种测试有没有必要?AD电源的纹波大小对AD最后量化有多大的影响?我看ADI还有使用DCDC给AD供电的,是不是这有特殊频率分量的纹波才能影响到AD的采样,比如我的采样率是30M,可能我LDO输出在30M带宽限制的时候,电源纹波也就是20mv左右,而300M全带宽可能到100mv!
? ? ? ? ?这个AD前端的电路中我最不满意的时钟方案,出来的采样时钟差,而且还会影响电源!不知道ADI还有没有好的时钟推荐方案,我的性噪比要做到60db以上,我现在输入什么都不接的情况下,底噪在10左右,大概是3位半,估计还要提高1位半才能达到指标,我的AD是单通道的,时钟为30M,时钟的抖动对信噪比影响太大了,不知道有没有好点的方案!还有如果还有什么其他方法可以提高信噪比,也希望大家指教!!!
? ? ? ? ?最后电路图附上,AD上有好多脚都是复用的可以使用FPGA配置,也可以通过IO配置AD的工作模式,AD的供电是使用单独的LDO产生的3.3V和1.8V。
附件:
ad.rar 下载次数: ?5 资源分:?0

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iampeter 编辑于 2013-1-20 下午12:03
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回复主题:如何提高AD9629采样的信噪比?

发布时间:2013-1-18 上午8:45

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楼主可以参加ADI征文活动:http://bbs.ednchina.com/FORUM_POST_33_11_0.HTM。如果是原创请在标题注明。
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第2楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-20 下午6:12

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楼主可以先将您的联系方式发至我邮箱:zhyuanqung@gmail.com。敬请关注4月初的评比结果。
EvelynZhang 编辑于 2013-1-21 下午8:41
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第3楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-21 下午7:46

作者: bitao1983

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第4楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-22 上午8:37

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我是指您的联系方式,到时候方便找到您。因为每期都有几个网友通知不到。:)
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第5楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-22 下午1:57

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其实我是过来提问题的,那个问号是问为什么没有技术支持回答我的问题!解决问题是关键,活动参不参加都是次要的!!!
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第6楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-22 下午4:34

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抱歉,是我疏忽看错了,此贴的问题编号为1月的Q86,已加急,我将在今晚提交给ADI。您也可以明天致电ADI咨询:4006-100-006 (工作时间:周一至周五 8:30 ~ 17:30)。
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第7楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-23 下午4:52

作者: bitao1983

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和ADI的技术支持,交流了一下还是电源纹波和时钟的问题比较大一点,现在是我想找一个单通道低抖动的时钟源,ADI的器件好像是没有的,不知道其他家有没有,比如Silicon Labs的VCXO的抖动也可以做到0.5PS不知道选一个LVDS输出的是否可以直接驱动AD!求解答!!!
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第8楼 回复主题:[征文+原创]如何提高AD9629采样的信噪比? 发布时间:2013-1-25 上午10:19

作者: ADI_Yu

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您好!AD9629的时钟可兼容CMOS/LVDS/LVPECL逻辑电平。
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