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EDN China>EDN论坛>是德科技Keysight技术论坛专区>DDR3的信号完整性测试
楼主 问题:

DDR3的信号完整性测试

发布时间:2015-7-21 上午11:42

作者: 沙漠风铃

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最近公司使用国产的CPU,出现DDR3不稳定,不知道测试DDR的数据及时钟的信号完整性有没有实际意思?

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EDN China电子设计技术高度集成的传感器接口模拟前端简化了传感器调理
第1楼

回复主题:DDR3的信号完整性测试

发布时间:2015-7-22 上午11:08

版主

作者: 大雁飞过

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DDR3不稳定,原因可能是多样的,你可试着从以下几个角度去分析: DDR3电源的上电时序(可用DSO/MSO观察); DDR3电源完整性(电源纹波、PDN输出阻抗和直流增益等) DDR3信号完整性(CLK,DQS,DQ)(可用LA的Eyescan功能粗略定位有问题的信号,再用示波器详细分析); 如果有可能,建议在仿真阶段就做以上测试,我们有客户,其仿真结果和最后实际测试结果十分吻合。
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EDN China电子设计技术大环境惨淡仍能逆市上扬,奥特斯是吹牛还是真本事?
第2楼 回复主题:DDR3的信号完整性测试 发布时间:2015-7-27 上午8:46

作者:江苏省南京市的游客

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DDR信号测试难度主要是读写分离。很多开发人员遇到系统无法启动时,找不到其他原因,就会要求测试DDR信号,但是也不知道如何入手。 除了楼上的几个建议外,还可以测试的刷新间隔tREFI,还有个看看配置tRFC(这个不太好测试,直接看软件的配置,是否与DDR符)
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EDN China电子设计技术看看无人机上用的这些传感器,传感技术起到了什么作用?
第3楼 回复主题:DDR3的信号完整性测试 发布时间:2016-3-22 下午6:22

作者: 欧阳睿麟

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信号完整性能分析出很多潜在问题,如果加上timing 以及采用LA观察完整的应用会更好。
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