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sunyzz的博客——sunyzz

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我开通微信公众号啦,喜欢的小伙伴可以继续关注sunnyzz163 [生活点滴] 发布时间:2016-05-28 18:50:06
公众号:sunnyzz163后续会不断的推送干货哟!!
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【转】看穿芯片之处理器CPU [自由话题] 发布时间:2016-05-16 22:02:52
回到最初的问题,CPU是怎样访问内存的?简单的答案是,CPU执行一条访存指令,把读写请求发往内存管理单元。内存管理单元进行虚实转换,把命令发往总线。总线把命令传递给内存控制器,内存控制器再次翻译地址,对相应内存颗粒进行存取。之后,读取的数据或者写入确认按照原路返回。再复杂些,当中插入多级缓存,在每一层缓存都未命中的情况下,访问才会最终达到内存颗粒。知道了完整的路径,那我们开始研究每一步中的硬件到底是怎么样的,读写指令到底是怎样在其中传输的。要了解硬件,首先要说下处理器。处理器的基本结构并不复杂,一般分为取指令,译码,发射,执行,......
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【博客大赛】电子工程师工作两年的经验分享 [自由话题] 发布时间:2016-05-06 22:22:42
一、环境初体验1.?????? 职场初来乍到,对新的环境有何感觉?不再像学校那么自由和随心所欲,每天要严格打卡上下班,你可以晚走,但是绝对不能早走,你可以不吃饭,但是绝对不能不工作;公司的工作氛围很好,以我们的小组而言,大家也经常的一块讨论项目如何进展,不会的时候问前辈,他们也很耐心的教导;楼上有羽毛球馆,一周可以打两次羽毛球,我很喜欢打羽毛球,所以我很喜欢楼上。哈哈!公司有三个社团,羽毛球社团,电影社团,篮球社团,每年每个人有一定的费用可以用来活动!公司每年提供一次旅......
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【博客大赛】电子工程师工作两年的经验分享 [自由话题] 发布时间:2016-05-05 22:23:49
一、环境初体验1.?????? 职场初来乍到,对新的环境有何感觉?不再像学校那么自由和随心所欲,每天要严格打卡上下班,你可以晚走,但是绝对不能早走,你可以不吃饭,但是绝对不能不工作;公司的工作氛围很好,以我们的小组而言,大家也经常的一块讨论项目如何进展,不会的时候问前辈,他们也很耐心的教导;楼上有羽毛球馆,一周可以打两次羽毛球,我很喜欢打羽毛球,所以我很喜欢楼上。哈哈!公司有三个社团,羽毛球社团,电影社团,篮球社团,每年每个人有一定的费用可以用来活动!公司每年提供一次旅......
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【博客大赛】聊聊创客 [生活点滴] 发布时间:2016-05-01 18:20:24
????? 不知不觉中,创客这个词汇已经像互联网+,云计算,物联网这些当前大咖词汇一样热门了。然而,我们需要的不仅仅是词汇的热门,更需要的是大家对他 的热情,让他真正能够服务于大众,服务于人民。不要只局限just for fun,更多的是just for do。事实上,不管设计创客和工程师也好,研发工程师也罢,在日益追求电子产品创意设计化的今天,无论是在外观结构设计,抑或是内部电路设计最优化考虑。一个优秀的创客或技术工程师不可能只是沉浸于一个狭小的技术领域中闭门造车just fo......
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【博客大赛】电子工程师的烦恼,你不懂! [资源共享] 发布时间:2016-04-27 21:35:26
一、为毛总是我,曾经的你曾梦想仗剑走天涯看一看世界的繁华年少的心总有些轻狂如今你四海为家曾让你心疼的姑娘如今已悄然无踪影爱情总让你渴望又感到烦恼曾让你遍体鳞伤DiLiLi……DiLiLi……DiLiLi……走在勇往直前的路上DiLiLi……DiLiLi……DiLiLi……有难过也有精彩每一次难过的时候就独自看一看大海总想起身边走在路上的朋友有多少正在疗伤DiLiL......
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SOC感悟----异常路径的时序分析 [资源共享] 发布时间:2016-04-25 21:42:11
6、false 路径硬件设计中总是会存在一些不可能的逻辑电路路径,这一种路径需要设置成false path,目的是让工具不再对其进行优化和时序检查。比较常见的false path例如两个时钟域之间的逻辑,如果你不指定为falth path,那么工具费很大的力气也很难让时序满足,因为本身跨时钟域时序关系就是不确定的。关掉的目的就是不让工具检查,省时省力,而他们之间的正确性要靠cdc处理(可以参考我之前写的关于cdc的 处理方法)。另外还有scan逻辑和正常逻辑之间的逻辑也可以设置成false path。7、half cycle p......
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【博客大赛】SOC感悟-----多周期路径图文解析 [资源共享] 发布时间:2016-04-24 17:27:45
5、多周期路径建立时间(setup)多周期路径一般用在比较复杂的逻辑约束中,这些复杂的逻辑根本不可能在一个周期内完成,所以会出现多周期路径,例如有些乘法器就需要多个周期才能完成。保持时间(hold)一般而言,保持时间的检查建立在setup检查上,保持时间应该提前于建立时间1T(工具进行sta检查的时候就是如此,),所以应该有如下图的检查关系。?但是上图的hold检查点(要是launch点)是不对的,想象一下上图的uff1变成uff0频率的1/3,hold的检查点应该前移2T。所以检查点更新为clk1的第一个上升沿。上面......
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【博客大赛】SOC感悟----保持时间图文解析 [资源共享] 发布时间:2016-04-23 22:26:43
4、保持时间时序路径逐个解析Hold可以理解为最小的delay需求。有图可以得到如下公式Tlaunch + T + Tck2q + Tdp >= Tcapture + T + Thold也就是:Tck2q + Tdp + Tlaunch – Tcapture >= Thold所以delay不能太小,否则不能满足hold的要求,另外hold和周期也没有关系,所以和jitter也就没有关系(在同一个沿分析的)。1)DFF->DFF之间Hold 的检查和setup的检查类似,如下图,是两个DFF之间的hold检查。注......
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【博客大赛】SOC感悟----建立时间图文分析 [资源共享] 发布时间:2016-04-22 22:29:27
3、建立时间时序路径逐个解析1)Path2:从DFF的clk pin到另一个DFF/D端;建立时间可以看成是最大的delay。从上图的波形可以看出,要想让uff1稳定的采样到uff0的数据输出,也就是uff1/d,数据必须在红色箭头之前稳定,则根据上图的时序关系不难得出如下公式。Tlaunch + Tlogic + Tsetup <= Tcapture + Tcycle,其中Tlogic = Tck2q + Tdp,Tlanch-Tcapture = Tuncertainty;上式变为Tuncertainty + Tlog......
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