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逻舞的博客——FPGA实践技术分享

博主:逻舞???? ???? ????
介绍: 这里分享的FPGA技术都是我一点点工程实践的积累,请大家不吝赐教,欢迎来砸场子。
文章(14)???? 访问(19922)???? 评论(113)???? 投票(58)???? 订阅本博??

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【博客大赛】FPGA实现实时视频加权均值滤波 [CPLD/FPGA] 发布时间:2015-09-09 10:18:36
本文设计的是一种加权均值滤波算法,窗口大小是5(列)*1(行),适用于灰度图像实时视频处理,可以有效淡化视频竖条纹。同时为了保持图像的细节,采用如下图所示的加权窗口。同时考虑到一场视频最左边和最右边的2列数据的特殊性,其窗口对应为:最左边两列最右边两列代码接口定义如下表所示。接口名称输入输出接口含义I_clk_7mI视频采样时钟,实际为6.75MHzI_reset_nI系统复位信号,低复位I_smooth_enI均值滤波使能信号,1:使能,0:不使能......
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Vivado IP core管理-FPGA器件型号变更时的 IP core管理 [CPLD/FPGA] 发布时间:2015-09-01 15:28:34
在FPGA工程开发和维护的过程中,有可能需要在原有的代码上进行增量开发,但是发现原来选用的FPGA器件资源不够,需要更换器件。对于你自己一行行写的代码都好办,但是工程里调用的IP core与FPGA器件的型号是相关联的,必须进行必要的管理。比如在Vivado2013.4版本上从ZYNQ7010升级到ZYNQ7020器件,针对IP core的具体操作如下:1、使用Vivado2013.4工程,在Project Summary下面的Project Setting里点击器件型号。2、弹出下图所示的对话框,点击下图红框位置,重新选择器件......
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Vivado IP core管理-Vivado版本升级时的 IP core管理 [CPLD/FPGA] 发布时间:2015-09-01 15:25:32
在FPGA工程开发和维护的过程中,有可能需要将vivado的旧版本的代码移植到新版本的vivado平台(如果你想逆向操作,个人建议还是下点功夫熟悉下新版本吧,要与时俱进哦)。对于你自己一行行写的代码都好办,但是工程里调用的IP core与vivado的版本是相关联的,必须进行必要的管理。比如从vivado2013.4升级到vivado2014.4,针对IP core的具体操作流程如下:1、使用vivado2014.4打开vivado2013.4的工程,会出现下图所示的对话框,选择Automatically upgrade to ......
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【来点不一样的】Microsemi(原Actel)最新FPGA和开发板介绍 [CPLD/FPGA] 发布时间:2015-08-25 16:55:02
最近接触到了一款Microsemi(原Actel)的代理商艾懋电子开发的SmartFusion2 Starter Kit开发板,逐渐了解了Microsemi(原Actel)FPGA的一些情况。Microsemi FPGA相关介绍了解FPGA的人都知道,FPGA的两大巨头Xilinx和Altera,另外还有一家做中低端FPGA和CPLD的Lattice,但是可能对另外一家Actel的FPGA可能了解比较少。Actel公司成立于1985年,位于美国纽约。之前的20多年里,ACTEL一直效力于美国军工和航空领域,并禁止对外出售。国内一......
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(6)-烧写程序 [CPLD/FPGA] 发布时间:2015-08-04 20:50:49
? ? 上一篇我们使用Run configuration的方式运行程序,将代码加载到DDR中进行调试,掉电之后代码就丢失了。作为产品的话,需要把代码烧写到flash中,进行上电自启动,下面就介绍何如生成flash烧写文件,以及如何烧写flash。? ? 首先要生成FSBL文件,FSBL全称为First Stage Boot Loader,它主要完成PS代码的初始化,并引导程序的加载。? ? 打开之前SDK的Workspace,在主菜单中选择File->New-&g......;
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(5)-调试简单程序 [CPLD/FPGA] 发布时间:2015-08-04 20:42:42
? ?上一篇我们搭建基于ARM的硬件和BSP环境,下面我们跑一个最简单的HelloWorld的程序,作为流程的简单示范。? ?首先打开SDK,打开上次的Workspace,在SDK的主菜单中选择File->New->Application Project...。? ? 在弹出的对话框中输入文件名,在下方Board Support Package中选择Using existing,使用我们在上篇已经创建的standalone_bsp_0。? &nbs......;
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(4)-搭建硬件和BS... [CPLD/FPGA] 发布时间:2015-07-28 20:59:25
? ? 上一篇我们配置了ARM核的IP,下面就要搭建基于ARM的硬件开发环境,能在ARM编写和调试程序,需要将IP中的硬件信息导入到SDK开发套件中。? ? 打开上次建立的工程,然后Open Block Design,选择system_test.bd。? ? 在Vivado主菜单中选择File->Export->Export hardware for SDK...。 ? ?? ? 出现如下对话框,在此对话框中可以需勾选......
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(3)-配置IP [CPLD/FPGA] 发布时间:2015-07-28 20:41:29
? ? 上一篇我们建立了一个空的工程,Xilinx通过IP把子系统集成到工程中,并且使用block design的方式。? ? ?打开上次建立的工程,在左边IP Integrator中下面点击Create Block Design。? ? ??? ? 输入模块名称,点击OK。? ? 这时Diagram界面是空的,需要添加IP,点击Diagram界面上方的Add IP。? ? 在弹出......
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(2)-Vivado中建... [CPLD/FPGA] 发布时间:2015-07-28 20:30:27
? ? 建议使用Vivado而不是ISE调试MicrZed开发环境吗,因为随着器件按规模的急剧增大,并伴随SoC设计的增加,使用Vivado全新的布局布线算法,效率会提高很多。? ? 我这里使用的是64位Windows7操作系统、Xilinx Vivado2013.4。? ? 首先,打开Vivado2013.4。? ? 点击Creat New Project,然后点击NEXT,输出工程名并选择工程目录,勾选Create project subdire......
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AVNET MicroZed开发板(基于ZYNQ-7000)调试笔记(1)-开发板介绍 [CPLD/FPGA] 发布时间:2015-07-28 20:26:27
? ? 随着技术的发展和融合,SoC设计在FPGA上应用的越来越广泛。作为FPGA工程师,不能仅限于逻辑的开发,最起码要熟悉FPGA逻辑与内嵌ARM之间的开发流程,与软件工程师共同搭建硬件平台并进行仿真和调试。由于项目的原因,之前我的主要精力都放在逻辑开发方面,涉及的主要是各种接口、各种逻辑算法的实现,对SoC开发仅仅是了解。最近开始接触了ZYNQ-7000系列FPGA的开发,基于AVNET MicroZed开发板做了调试。下面就分篇和大家分享下我的调试经验。? ? 首先上图前视图侧视图功......
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