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小梅哥的博客——一点一滴到永恒

博主:小梅哥???? ???? ????
介绍: 与广大电子技术爱好者交流分享。不怕暴露自己的无知,只怕对自己的无知尚一无所知。(芯航线FPGA技术支持QQ群 : 472607506 欢迎交流学习)
文章(40)???? 访问(78093)???? 评论(193)???? 投票(163)???? 订阅本博??

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【博客大赛】小梅哥FPGA学习笔记之将sof文件和NIOS II的elf固... [CPLD/FPGA] 发布时间:2016-02-01 17:26:30
??? 我们在学习和调试NIOS II工程的时候,一般都是先使用Quartus II软件中提供的Quartus Programmer来烧写FPGA配置文件(SOF),然后NIOS II EDS中提供的Flash Programmer工具来进行烧写NIOS II的。这对于开发者来说,并没有什么不便,反而因为这种方式的灵活,为开发带了了很大的便利。然而,当我们的产品已经设计完成并量产的时候,就需要将固件烧写到产品中。生产线上进行烧录时,总希望能够用最简单的方式实现。试想,如果生产线上在进行烧写时,还需要......
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【博客大赛】小梅哥FPGA学习笔记之Verilog语法基础讲解之参数... [CPLD/FPGA] 发布时间:2016-02-01 08:28:33
??????? 在Verilog语法中,可以实现参数化设计。所谓参数化设计,就是在一个功能模块中,对于一个常量,其值在不同的应用场合需要设置为不同的置,则将此值在设计时使用parameter 关键字声明,那么在上层模块例化使用该功能模块时,可以根据具体需求重新配置该常量的值,从而实现不同应用场合对对应常量的灵活调整。??????? 以下为使用Verilog设计的一个控制LED闪烁灯的模块代码......
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【博客大赛】小梅哥FPGA学习笔记之带有JTAG UART 的NIOS II处... [CPLD/FPGA] 发布时间:2016-01-29 23:40:22
???? 今天,有网友在群里提问“我这个简单的闪灯程序(无其它任何多余的逻辑或*.c),运行久了,居然会死机!运行环境:EPCQ+片上RAM+NIOS II的方式。时钟:37.125MHz,通过JTAG电缆Debug NIOS,则不会。这是怎么回事呀 ?”??? 相信这样一个问题,很多人都遇到过,我之前在做NIOS II应用开发时,也遇到过这个问题,当时怀疑是NIOS II不稳定导致的,因为各大网络论坛和QQ群,吐槽NIOS II处理器......
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【博客大赛】小梅哥和你一起深入学习FPGA之Verilog HDL基础语... [CPLD/FPGA] 发布时间:2016-01-29 17:40:40
???????? 小梅哥接触过不少的从0开始接触Verilog语法的朋友,他们对于语法的掌握基本趋近于0,对于使用Verilog描述一个逻辑模块的最基本结构都不清楚,因此这里小梅哥特地使用一个例子来介绍一下使用Verilog设计数字逻辑模块的一般结构。???????? 本章主要讲解Verilog基础语法的内容,文章以一个最简单的例子“二选一多路器”......
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【博客大赛】小梅哥FPGA学习笔记之Altera FPGA使用JIC文件配置... [CPLD/FPGA] 发布时间:2016-01-27 17:21:38
??? 很多做过单片机的朋友都知道,我们在对MCU烧写完程序固件后,那么该程序固件就存储在了该MCU内部。即使MCU断电了再重新上电,程序也能继续运行。这是因为对MCU烧写固件的实质就是将程序固件写入到MCU的片上程序存储器ROM中,而现代的大部分MCU这个ROM都是FLASH存储器。FLASH存储器能够掉电保持数据,所以可以实现掉电程序不丢失。Altera或Xilinx的FPGA芯片,使用的是基于SRAM结构的查找表,而SRAM的一大特性就是掉电数据会丢失,当我们使用JTAG将SRAM配置文件(.......
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【博客大赛】小梅哥FPGA博文系列时隔半年,是时候该回归了 [CPLD/FPGA] 发布时间:2016-01-26 08:44:39
???? 各位EDNChina的网友,一晃,小梅哥已经大半年没来EDNChina发表博客了。回顾上一次发表博客,还是在15年6月20号。如今,已经16年了。这段日子,并不是我懈怠了,不愿意写东西了,而是太忙,每天忙着设计调试开发板,录制视频教程,进行技术支持,实在是无法分身。年底了,各个学生也都放假回家了,公司的项目也做的差不多了,终于有时间再来EDNChina侃侃大山了。???? 首先介绍下这半年来我都做了些什么吧。记得曾经,我说过我想设计一款FP......
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【博客大赛】小梅哥FPGA学习笔记之Quartus II 15.0中仿真DDR2 I... [CPLD/FPGA] 发布时间:2015-06-20 13:06:46
小梅哥FPGA学习笔记之Quartus II 15.0中仿真DDR2 IP核虽然近期用不上DDR2的控制器,但是昨天成功仿真Altera 三速以太网IP核又确实让我兴奋了一把,趁着这个兴奋劲儿,再一举拿下DDR2的IP核仿真。?仿真还是在Altera 最新的开发套件Quartus II 15.0中进行。首先创建工程,我将工程命名为DDR2_SIM,器件选择我比较熟悉的EP4CE10F17C8,仿真工具选择modelsim – altera ,语言为Verilog。最后,整个工程建立完毕后的Summary如下图所示:工程......
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【博客大赛】小梅哥FPGA学习笔记之Quartus II 15.0中仿真Alter... [CPLD/FPGA] 发布时间:2015-06-19 22:47:56
(接上篇)编译完成后,一般不会出现错误,这时候,就可以通过设置NativeLink来将Quartus II工程文件与Modelsim-Altera软件关联起来了。设置NaitveLink的详细步骤如下图所示:点击Assignments—>Settings 在弹出的对话框中(如下图所示)选择EDA Tool Settings(红框1处),选择Simulation(红框2处),核对红框3处和4处是否与图上设置的一致,然后勾选红框5处的Compile test bench,点击红框6处的Test Benches以进入新的test......
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【博客大赛】小梅哥FPGA学习笔记之Quartus II 15.0中仿真Alter... [CPLD/FPGA] 发布时间:2015-06-19 22:27:32
小梅哥FPGA学习笔记之Quartus II 15.0中仿真Altera三速以太网IP核?(友情提示:图片有点多,默认缩小状态下可能看不清楚,点击图片可查看高清大图哦)?近期的项目需要用到网络端口通过UDP协议来进行数据的与PC机的交互。FPGA系统中实现网口有多种方式,包括友晶的DE2-35开发板上使用的NIOS II处理器通过外部MAC芯片DM9000实现的web server,以及DE2-115开发板上使用NIOS II处理器与三速以太网(TSE)IP核实现web server,再就是W5X00系列的硬......
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【博客大赛】小梅哥fpga学习笔记之NIOS II CPU复位异常的原因... [CPLD/FPGA] 发布时间:2015-05-26 18:16:48
近期在用nios ii做项目时,发现一个奇怪的现象,在NIOS II EDS软件中编写好的代码,烧写到芯片中,第一次能够正常运行,但是当我按下板卡上的复位键之后,系统却卡死了,再也运行不起来,除非重新下载程序。经过分析系统可知,系统的硬件设计和Qsys系统中NIOS II CPU系统的搭建都是没有任何问题的。那么为什么会存在这样的问题呢,这里我先简单介绍下我的系统:我的系统主要由NIOS II最强板CPU,SDRAM、预留系统定时器、预留时间戳定时器、system ID、EPCS控制器以及JTAG_UART组成。具体如下图所示(......
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