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WCG的博客——wenchenggan

博主:WCG???? ???? ????
介绍: 主要是记载一些自己学习方面的东西
文章(11)???? 访问(8451)???? 评论(10)???? 投票(7)???? 订阅本博??

博文列表查看方式: ???

The art of counting in fpga(2) [CPLD/FPGA] 发布时间:2015-05-16 23:43:52
接前面,居然一篇放不下---------------------------------------------------------------------------------CustomizationYou?can?tweak?the?LFSR:·?Select?a?different?number?of?taps?(we?chose?8?above).&middot......;
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The art of counting in fpga(1) [CPLD/FPGA] 发布时间:2015-05-16 23:41:53
转载至fpga4fun,觉得对重新理解fpga很好,而且从来没有在中文网站上看到这种东西,而且讲的通俗易懂,以后多看点英文网站。先转下来备忘,从以前的一个自己的博客上转载过来的。。(1)Binary?countersThe?simplest?of?countersA?fast?and?efficient?binary?counter?can?be?built?using?a?cou......
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多相抽取fir滤波器的fpga仿真实现 [CPLD/FPGA] 发布时间:2015-04-25 18:13:37
今天仿真了下多相抽取滤波器的仿真实现,其原理其实很简单就是根据抽取的原则,将fir滤波器的系统函数分解,称之为多相,所以又叫多相抽取滤波器。一、原理如下图:?系统实现函数为:?二、参考一篇论文和田耕书仿真如下:结合matlab参数进行测试,代码贴在最后面:matlab输出结果:?modesim仿真结果如下:??两者结果还是相同的。。?现在把源代码贴在下面:matlab代码:close all;clc;clear all;h = [0.4......
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直接型iir滤波器的matlab实现和modesim仿真对比 [CPLD/FPGA] 发布时间:2015-04-19 00:27:50
本文测试直接I型的IIr低通滤波器在matlab中和在fpga实现中有什么不同。。为了看的清楚写的简略,可以参考后面贴的代码第一步:产生两个信号源,采样率fs =1000hz,单频信号fc1 = 50hz,单频信号fc2 = 300hz,其中肯定是想滤掉fc2的。原始数据频谱:第二步:在matlab中用函数设计和fpga一样的8阶滤波器,来进行滤波。其中分两种情况滤波,一种是直接用filter函数,另一种是用自己写的有实现过程的滤波,模拟fpga中动作,看效果如何matlab设计的8阶参数频谱:matlab调用自带滤波函数fil......
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fir 滤波器的matlab实现和modesim实现仿真对比 [CPLD/FPGA] 发布时间:2015-04-13 01:14:39
本测试主要是为了测试fir滤波器在matlab和modesim中有什么不同。。用的fir滤波器都是8阶直接,而且信号处理过程也是一模一样。第一步:以matlab为原型,现在matla中产生双单点频信号然后用matlab中的自己写的滤波器看滤波效果如何第二步:以matlab为原型,在quartus中写相同处理过程的fir滤波器,,然后导入matlab输出的源数据,通过fir后导出数据,将fpga滤波后的数据交由matlab处理,画出频谱图对比第一步中的matlab处理后的滤波数据,看效果如何?原始数据频谱图:?......
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matlab和modesim的一种读写交互方式(通过txt文件) [CPLD/FPGA] 发布时间:2015-04-09 22:58:28
在进行modesim仿真时,由于matlab强大的数据处理能力,时常需要比较复杂的激励或者需要把仿真结果保存下来用matlab来处理。利用matlab工具来辅助modesim仿真显得十分重要。。第一步:matlab产生数据源close all;clc;clear allN = 256;n = 1:N;x = fix(128 + (2^7 - 1) * sin(2*pi*n/N));%把波形抬高,有符号转为无符号不是这么转的plot(x)fid = fopen('sin.txt','wt');fpr......
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FFT的理解 [CPLD/FPGA] 发布时间:2015-04-09 21:59:52
觉得很好,全文转载:说明:原文见于网络,原文名称《FFT的物理意义》,本文为了使说明更加形象,将附录代码的绘图结果给出,希望有助于大家的理解。FFT是离散傅立叶变换的快速算法,可以将一个信号变换到频域。有些信号在时域上是很难看出什么特征的,但是如果变换到频域之后,就很容易看出特征了。这就是很多信号分析采用FFT变换的原因。另外,FFT可以将一个信号的频谱提取出来,这在频谱分析方面也是经常用的。虽然很多人都知道FFT是什么,可以用来做什么,怎么去做,但是却不知道FFT之后的结果是什意思、如何决定要使用多少点来做FFT。现在就根据实......
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【先挖坑,懂了再来填】遇到一个dsp和fpga交互的问题 [CPLD/FPGA] 发布时间:2015-04-09 11:46:18
最近遇到一个dsp和fpga交互的问题,虽然问题已经解决,但是原因还是没弄太懂,先挖一个坑,以后再填,或者看过这篇博文知道的答案的,希望能指教一二。?问题是这样的:dsp通过emif外挂了三个外设:sdram,flash,fpga,dsp和fpga也是通过emif进行交互,其中dsp是主,fpga为从处理器,控制emif交互的有CE,AOE,AWE三根控制线,和16跟地址线,32根数据线。画个图,好理解一点?那么问题来了,如果fpga先把程序下进去的时候,dsp下程序时刚好下到sdram空间时就会报错,如果f......
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verilog实现串口 [CPLD/FPGA] 发布时间:2015-04-09 11:36:42
?主要记录自己在利用verilog实现串口的时候一些简单的介绍和遇到问题和思考。备忘?1、串口传输格式,可以百度,有很多也很简单。串口分为两部分,一个收,一个发。所以在verilog实现时可以把这两部分分开。也就是两个fifo配套收和发的.v文件,可以实现一个串口。一般人实现串口的都是这么想的吧。下面是文件的层级结构:?2、当然是coding了。写串口的代码。主要贴一下收和发的状态机(用一段来实现的):(1)这是收的部分:case(state_rxd)state_rxd_idle?:&nb......;
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matlab实现下变频仿真 [CPLD/FPGA] 发布时间:2015-04-07 00:00:44
主要是为了测试下变频对信号信噪比的影响。下变频主要包括:频率搬移+低通滤波+抽取信号来实现代码如下:close all;clc;clear all;fs = 150e6; ? %原始数据采样率fc = 46.519e6;%信号中频fdown = 30e6;%下变频率n = fs*0.001;bit_width = 8??ts = 1/fs;nn = [1:1:n];??fid = fopen('D:\work\常用重要\test_xiabianpin20150324\Rx......
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